OP 앰프 이득 계산기
반전·비반전·차동 OP 앰프 회로의 이득, dB, 출력 전압, 입력 임피던스, 대역폭을 구하고, 목표 이득에 맞는 표준 저항 조합을 찾습니다.
저항은 4.7k, 4k7, 4,7k, 100 kΩ 형식, GBW는 1M 또는 1 MHz 형식으로 입력합니다.
이상적인 OP 앰프 모델(무한 개루프 이득, 오프셋·입력 전류 없음)입니다. 대역폭은 단일 극점 전압 궤환 부품을 가정합니다.
사용법
- 반전, 비반전, 차동, 설계 중 하나를 고릅니다.
- 저항값(4.7k, 4k7, 100 kΩ 모두 가능), 입력 전압, 전원 레일, OP 앰프의 이득 대역폭 곱을 입력합니다.
- 이득, 출력 전압, 노이즈 이득, 입력 임피던스, 대역폭을 확인합니다. 설계 모드에서는 목표 이득과 계열을 넣으면 가장 가까운 표준 저항 쌍이 나옵니다.
자세한 설명
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저항값으로 OP 앰프 증폭단이 실제로 어떻게 동작하는지 계산합니다. 반전 증폭기의 이득은 −Rf/Rin, 비반전 증폭기는 1 + Rf/Rg입니다. 이득과 함께 데시벨 값, 입력 전압에 대한 출력 전압, 노이즈 이득, 입력 임피던스, 폐루프 대역폭을 보여 주고, 출력이 전원 레일을 넘어야 하는 경우 경고합니다.
대역폭은 데이터시트를 보고도 틀리기 쉬운 값입니다. 전압 궤환 OP 앰프는 이득 대역폭 곱(GBW)만큼 이득과 대역폭을 맞바꾸는데, 대역폭을 정하는 것은 신호 이득이 아니라 노이즈 이득 1 + Rf/Rin입니다. 그래서 이득이 −1인 반전 증폭기도 노이즈 이득은 2이고, 대역폭은 GBW의 절반으로 이득 +2인 비반전 증폭기와 같습니다. 이 추정은 범용 부품에 맞는 단일 우세 극점을 가정하며, 전류 궤환 증폭기에는 맞지 않습니다. 큰 신호에서는 이 대역폭보다 슬루 레이트가 먼저 한계가 되기도 합니다.
차동 증폭기 모드는 네 저항을 따로 입력받습니다. 실제 회로가 틀어지는 곳이 바로 여기이기 때문입니다. R2/R1과 R4/R3가 같으면 출력은 (R2/R1)·(V2 − V1)이고 두 입력에 공통인 전압은 상쇄됩니다. 조금이라도 어긋나면 공통 모드 이득이 남고, 도구는 그 값과 공통 모드 제거비(CMRR)를 보여 줍니다. R1 = R3 = 10 kΩ, R2 = 100 kΩ에서 R4를 100 kΩ 대신 101 kΩ로 하면, 즉 저항 하나가 1 % 틀리면 CMRR이 약 61 dB로 제한됩니다. 정밀 차동 증폭기가 레이저 트리밍한 저항 네트워크를 쓰는 이유입니다.
설계 모드는 거꾸로 계산합니다. 목표 이득과 저항 계열(E12, E24, E96)을 주면 비율이 가장 가까운 표준 저항 한 쌍과 그 부품으로 실제 얻는 이득, 오차를 돌려줍니다. 입력 저항은 바이어스 전류에 의한 오프셋과 신호원 부하가 모두 작은 1 kΩ~10 kΩ 사이로 두고, 궤환 저항은 100 Ω에서 10 MΩ까지 찾습니다. 비반전 증폭기는 이득을 1보다 작게 만들 수 없고, 이득이 정확히 1이면 저항 없이 전압 팔로워를 쓰면 됩니다.
모든 계산은 이상적인 OP 앰프(무한 개루프 이득, 오프셋 없음, 입력 전류 없음) 모델입니다. 저항값은 4.7k, 4k7, 4,7k, 100 kΩ 형식을 모두 받으며, 입력한 내용은 브라우저 밖으로 나가지 않습니다.
자주 묻는 질문
이득 −1인 반전 증폭기의 대역폭이 왜 GBW의 절반인가요?
대역폭은 신호 이득이 아니라 노이즈 이득 1 + Rf/Rin을 따릅니다. Rf = Rin이면 신호 이득은 −1이지만 노이즈 이득은 2이므로, GBW 1 MHz인 OP 앰프에서 대역폭은 약 500 kHz입니다. 이득 +2인 비반전 증폭기도 노이즈 이득이 같아 대역폭이 같습니다.
클리핑 경고는 무슨 뜻인가요?
이상적인 출력이 입력한 전원 레일을 넘을 때 나타납니다. 실제 OP 앰프는 그 전에 멈춥니다. 많은 부품이 레일에서 1~2 V 안쪽까지만 출력하고, 레일 투 레일 부품도 부하가 걸리면 수십 mV를 잃습니다. 사용하는 부품 데이터시트의 출력 스윙을 확인하세요.
저항 1 % 불일치가 왜 차동 증폭기를 망치나요?
공통 모드 전압은 R2/R1과 R4/R3가 정확히 같을 때만 상쇄됩니다. R1 = R3 = 10 kΩ, R2 = 100 kΩ에서 R4가 101 kΩ이면 차동 이득 약 10에 공통 모드 이득 약 0.009가 남아 CMRR이 약 61 dB가 됩니다. 공통 모드 전압이 크면 정합 저항 네트워크나 집적형 차동 증폭기를 쓰세요.
비반전 증폭기로 이득 1 미만을 설계할 수 없는 이유는 무엇인가요?
이득이 1 + Rf/Rg이므로 양의 저항이면 항상 1 이상입니다. 감쇠가 필요하면 먼저 분압하거나 반전 증폭기를 쓰고, 이득이 정확히 1이면 출력을 반전 입력에 연결한 전압 팔로워를 저항 없이 쓰면 됩니다.
설계 모드는 입력 저항을 어떻게 고르나요?
입력(또는 접지 쪽) 저항은 1 kΩ~10 kΩ 구간에서, 궤환 저항은 선택한 계열의 100 Ω~10 MΩ에서 찾습니다. 값이 더 작으면 신호원에 부하가 걸리고 전류가 낭비되며, 훨씬 크면 바이어스 전류 오프셋과 잡음이 커집니다. 다른 임피던스가 필요하면 두 저항에 같은 배수를 곱하면 됩니다. 비율, 즉 이득은 그대로입니다.
비반전 증폭기의 입력 임피던스는 정말 무한대인가요?
아닙니다. 다만 저항이 아니라 OP 앰프 자체의 입력 임피던스로 정해지며, 바이폴라 입력은 보통 수 MΩ, CMOS·JFET 입력은 TΩ급입니다. 반전 증폭기는 다릅니다. 반전 입력이 가상 접지에 묶여 있어 입력 임피던스가 곧 Rin입니다.
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